S25FL128SAGMFIR01 128Mb SPI NOR Flash 104MHz Clock 100K Cicli di Cancellazione 20 Anni di Conservazione Dati 2.7-3.6V SOIC-16 -40°C a +85°C

S25FL128SAGMFIR01 128Mb SPI NOR Flash 104MHz Clock 100K Cicli di Cancellazione 20 Anni di Conservazione Dati 2.7-3.6V SOIC-16 -40anddeg;C a +85anddeg;C

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Caratteristiche

andbull; Core CMOS 3.0V con I/O versatile

andbull; Interfaccia Periferica Seriale (SPI) con multi-I/O

- Polarità e modalità di fase dell'orologio SPI 0 e 3

- Opzione DDR

- Indirizzamento esteso: opzioni di indirizzo a 24 o 32 bit

- Set di comandi seriali e footprint compatibili con le famiglie SPI S25FL-A, S25FL-K e S25FL-P

- Set di comandi Multi I/O e footprint compatibili con la famiglia SPI S25FL-P

andbull; Comandi di lettura

- Normale, Veloce, Duale, Quad, Fast DDR, Dual DDR, Quad DDR

- AutoBoot andndash; Accensione o ripristino ed esecuzione automatica di un comando di lettura Normale o Quad a un indirizzo preselezionato

- Dati Common Flash Interface (CFI) per informazioni di configurazione

andbull; Programmazione (1.5 MBps)

- Opzioni di buffer di programmazione pagina da 256 o 512 byte

- Programmazione pagina a ingresso quadruplo (QPP) per sistemi con clock lento

- Generazione automatica del codice di correzione degli errori (ECC) hardware interno con correzione degli errori a bit singolo

andbull; Cancellazione (0.5 a 0.65 MBps)

- Opzione di dimensione settore ibrida andndash; Set fisico di trentadue settori da 4 KB nella parte superiore o inferiore dello spazio di indirizzi con tutti i settori rimanenti da 64 KB, per la compatibilità con i dispositivi S25FL di generazione precedente

- Opzione settore uniforme andndash; cancella sempre blocchi da 256 KB per la compatibilità software con dispositivi a densità più elevata e futuri

andbull; Resistenza ai cicli

- 100.000 cicli di programmazione-cancellazione, minimo

andbull; Conservazione dei dati

- 20 anni di conservazione dei dati, minimo

andbull; Funzionalità di sicurezza

- Array OTP (One-Time Programmable) di 1024 byte

- Protezione dei blocchi

andbull; Bit del registro di stato per controllare la protezione contro la programmazione o la cancellazione di un intervallo contiguo di settori

andbull; Opzioni di controllo hardware e software

- Protezione settoriale avanzata (ASP)

andbull; Protezione settoriale individuale controllata dal codice di avvio o dalla password

andbull; Tecnologia MIRRORBITandtrade; a 65 nm con architettura Eclipse

andbull; Tensione di alimentazione del core: da 2.7 V a 3.6 V

andbull; Tensione di alimentazione I/O: da 1.65 V a 3.6 V

- Pacchetti SO16 e FBGA

andbull; Intervallo di temperatura/grado:

- Industriale (-40anddeg;C a +85anddeg;C)

- Industriale Plus (-40anddeg;C a +105anddeg;C)

- Automotive AEC-Q100 grado 3 (-40anddeg;C a +85anddeg;C)

- Automotive AEC-Q100 grado 2 (-40anddeg;C a +105anddeg;C)

- Automotive AEC-Q100 grado 1 (-40anddeg;C a +125anddeg;C)

andbull; Pacchetti (tutti senza Pb)

- SOIC a 16 pin (10.30 andtimes; 7.50 andtimes; 2.65 mm) (300 mil)

- DFN a 8 pin (6.0 andtimes; 8.0 andtimes; 0.8 mm) (WSON)

- FBGA a 24 sfere (8.0 andtimes; 6.0 andtimes; 1.2 mm)

andbull; Opzioni di footprint a 5 andtimes; 5 sfere (FAB024) e 4 andtimes; 6 sfere (FAC024)

andbull; Die noto buono (KGD) e die testato noto

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Descrizione generale

I dispositivi Infineon S25FL128S e S25FL256S sono prodotti di memoria non volatile flash che utilizzano:

andbull; Tecnologia MIRRORBITandtrade; andndash; che memorizza due bit di dati in ogni transistor dell'array di memoria

andbull; Architettura Eclipse andndash; che migliora notevolmente le prestazioni di programmazione e cancellazione

andbull; Litografia del processo a 65 nm

Questa famiglia di dispositivi si collega a un sistema host tramite SPI. L'ingresso e l'uscita seriali a bit singolo SPI tradizionale (Single I/O o SIO) sono supportati, così come i comandi seriali opzionali a due bit (Dual I/O o DIO) e a quattro bit (Quad I/O o QIO). Questa interfaccia a larghezza multipla è chiamata SPI Multi-I/O o MIO. Inoltre, la famiglia FL-S aggiunge il supporto per i comandi di lettura DDR per SIO, DIO e QIO che trasferiscono l'indirizzo e leggono i dati su entrambi i bordi dell'orologio.

L'architettura Eclipse presenta un buffer di programmazione pagina che consente di programmare fino a 128 parole (256 byte) o 256 parole (512 byte) in un'unica operazione, con conseguente programmazione ed eliminazione effettive più veloci rispetto agli algoritmi di programmazione o cancellazione SPI di generazione precedente.

L'esecuzione del codice direttamente dalla memoria flash è spesso chiamata eXecute-in-Place o XIP. Utilizzando i dispositivi FL-S alle velocità di clock più elevate supportate, con i comandi QIO o DDR-QIO, la velocità di trasferimento di lettura delle istruzioni può corrispondere o superare le tradizionali interfacce parallele, memorie flash NOR asincrone, riducendo drasticamente il numero di segnali.

I prodotti S25FL128S e S25FL256S offrono alte densità abbinate alla flessibilità e alle prestazioni veloci richieste da una varietà di applicazioni embedded. Sono ideali per il code shadowing, XIP e l'archiviazione dei dati.

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INFORMAZIONI

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Disegno

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