IS42S16320B-7TL SDRAM 64Mb Densità 166MHz Velocità 3.3V Operazione 16Mx16 Organizzazione LVTTL Interfaccia Temperatura industriale (-40°C~85°C) Compatto pacchetto TSOP-II Alta affidabilità

IS42S16320B-7TL SDRAM 64Mb Densità 166MHz Velocità 3.3V Operazione 16Mx16 Organizzazione LVTTL Interfaccia Temperatura industriale (-40°C ~ 85°C) Pacchetto TSOP-II Compatto Alta affidabilità

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Caratteristiche

frequenza di orologeria: 166, 143, 133 MHz

andbull; pienamente sincrono; tutti i segnali riferiti a un bordo orario positivo

e bull; banca interna per l'accesso/precarica a fila nascosta

e bull; alimentazione elettrica

e  e  e  e  e  e  e  e  e  e  e  e  e  e  e  e  e  e  e  Vddand  e  Vddq

enbsp; IS42/45S16320B 3.3Vandnbsp; enbsp;3.3V

enbsp; IS42S86400Bandnbsp; enbsp; enbsp; 3.3Vandnbsp; enbsp;3.3V

Interfaccia LVTTL

e bullo; lunghezza di scatto programmabile e polvere; (1, 2, 4, 8, pagina completa)

andbull; Sequenza di scoppio programmabile: Sequenziale/Interleave

andbull; aggiornamento automatico (CBR)

eBull; Self Refresh

andbull; cicli di aggiornamento 8K ogni 16 ms (grado A2) o 64 ms (grado commerciale, industriale, A1)

andbull; Indirizzo di colonna casuale ogni ciclo dell'orologio

andbull; latenza CAS programmabile (2, 3 ore)

andbull; capacità di lettura/scrittura e di lettura/scrittura singola

andbull; terminazione della scarica mediante comando di arresto della scarica e di precarica

andbull; disponibile in TSOP-II a 54 pin e W-BGA a 54 palline (solo x16)

andbull; Intervallo di temperatura di funzionamento:

enbsp; Commerciale: da 0°C a +70°C

enbsp; industriale: da -40°C a +85°C

enbsp; Automotive, A1: da -40°C a +85°C

enbsp; Automotive, A2: da -40°C a +105°C

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VISUO IN GENERALE

ISSIand#39;s 512Mb Synchronous DRAM consente il trasferimento di dati ad alta velocità utilizzando l'architettura di pipeline.La SDRAM da 512 Mb è organizzata come segue:.

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Visualizzazione dell'apparecchio

La SDRAM da 512 Mb è una memoria CMOS ad alta velocità, a accesso casuale dinamico, progettata per funzionare in sistemi di memoria da 3,3 V Vdd e 3,3 V Vddq contenenti 536,870912 bit, configurati internamente come una DRAM quad-bank con un'interfaccia sincrona.217La banca a 728 bit è organizzata in 8192 righe per 1024 colonne per 16 bit.217Le banche a 728 bit sono organizzate in 8.192 righe per 2048 colonne per 8 bit.

La SDRAM da 512 Mb include una modalità di aggiornamento automatico e una modalità di disattivazione, che consente di risparmiare energia.Tutti gli ingressi e le uscite sono compatibili con LVTTL.

La SDRAM da 512 Mb è in grado di generare dati in modo sincrono ad un'alta velocità di trasmissione con generazione automatica di indirizzi di colonne,la possibilità di interlacciarsi tra banche interne per nascondere il tempo di precarica e la possibilità di modificare in modo casuale gli indirizzi delle colonne in ogni ciclo di orologeria durante l'accesso a scatto.

Una prericarica a fila automatizzata avviata alla fine della sequenza di scatti è disponibile con la funzione AUTO PRECHARGE abilitata.Precaricare una banca mentre si accede a una delle altre tre banche nasconderà i cicli di precarica e fornirà senza soluzione di continuità, ad alta velocità, con accesso casuale.

Gli accessi di lettura e scrittura della SDRAM sono orientati allo scoppio a partire da una posizione selezionata e continuano per un numero programmato di posizioni in una sequenza programmata.La registrazione di un comando ACTIVE inizia gli accessi, seguito da un comando READ o WRITE. Il comando ACTIVE in combinazione con i bit di indirizzo registrati viene utilizzato per selezionare la banca e la riga da accedere (BA0, BA1 selezionare la banca;A0-A12 selezionare la riga). I comandi READ o WRITE in combinazione con i bit di indirizzo registrati vengono utilizzati per selezionare la posizione della colonna di partenza per l'accesso rapido.

lunghezze di scatto programmabili READ o WRITE consistono in 1, 2, 4 e 8 posizioni o pagina completa, con un'opzione di terminazione di scatto.

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Descrizione

Le SDRAM da 512 Mb sono DRAM quad-bank che operano a 3,3 V e includono un'interfaccia sincrona (tutti i segnali sono registrati sul bordo positivo del segnale di orologeria, CLK).217Le banche a 728 bit sono organizzate in 8192 righe per 1024 colonne per 16 bit o 8192 righe per 2048 colonne per 8 bit.

Gli accessi di lettura e scrittura alla SDRAM sono orientati allo scoppio; gli accessi iniziano in una posizione selezionata e continuano per un numero programmato di posizioni in una sequenza programmata.Gli accessi iniziano con la registrazione di un comando ACTIVO seguito da un comando READ o WRITE. I bit di indirizzo registrati in coincidenza con il comando ACTIVE vengono utilizzati per selezionare la banca e la riga a cui accedere (BA0 e BA1 selezionano la banca, A0 A12 selezionano la riga).A0-A9, A11 (x8) registrati in coincidenza con il comando READ o WRITE sono utilizzati per selezionare la posizione della colonna di partenza per l'accesso a scatto.

Prima del normale funzionamento, la SDRAM deve essere inizializzata. Le sezioni seguenti forniscono informazioni dettagliate riguardanti l'inizializzazione del dispositivo, la definizione del registro,descrizioni dei comandi e funzionamento del dispositivo.

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Informazioni

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Disegno

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Elenco dei prodotti
Forniamo una serie di componenti elettronici, una gamma completa di semiconduttori, componenti attivi e passivi.


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Circuito integrato, circuiti integrati di memoria, diodo, transistor, condensatore, resistore, varistor, fusibile, trimmer e potenziometro, trasformatore, batteria, cavo, relè, interruttore, connettore, blocco terminale,Amplificatore di cristalloOscillatore, induttore, sensore, trasformatore, driver IGBT, LED,LCD, convertitore, PCB (Printed Circuit Board),PCBA (PCB Assembly)

Forte in Brand:
Microchip, MAX, AD, TI, ATMEL, ST, ON, NS, Intersil, Winbond, Vishay, ISSI, Infineon, NEC, FAIRCHILD, OMRON, YAGEO, TDK, ecc.